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企業(yè)商機
數字信號測試基本參數
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數字信號測試企業(yè)商機

對于真實的數據信號來說,其頻譜會更加復雜一些。比如偽隨機序列(PRBS)碼流的頻譜的包絡類似一個sinc函數。圖1.4是用同一個發(fā)送芯片分別產生的800Mbps和2.5Gbps的PRBS信號的頻譜,可以看到雖然輸出數據速率不一樣,但是信號的主要頻譜能量集中在4GHz以內,也并不見得2.5Gbps信號的高頻能量就比800Mbps的高很多。

頻譜儀是對信號能量的頻率分布進行分析的準確的工具,數字工程師可以借助頻譜分析儀對被測數字信號的頻譜分布進行分析。當沒有頻譜儀可用時,我們通常根據數字信號的上升時間估算被測信號的頻譜能量:

信號的比較高頻率成分=0.5/信號上升時間(10%~90%)

或者當使用20%~80%的上升時間標準時,計算公式如下:

信號的比較高頻率成分=0.4/信號上升時間(20%~80%) 數字此案好的上升時間(Rising Time);校準數字信號測試銷售

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數字信號的時域和頻域

數字信號的頻率分量可以通過從時域到頻域的轉換中得到。首先我們要知道時域是真實世界,頻域是更好的用于做信號分析的一種數學手段,時域的數字信號可以通過傅里葉變換轉變?yōu)橐粋€個頻率點的正弦波的。這些正弦波就是對應的數字信號的頻率分量。假如定義理想方波的邊沿時間為0,占空比50%的周期信號,其在傅里葉變換后各頻率分量振幅。

可見對于理想方波,其振幅頻譜對應的正弦波頻率是基頻的奇數倍頻(在50%的占空比下)。奇次諧波的幅度是按1"下降的(/是頻率),也就是-20dB/dec(-20分貝每十倍頻)。 DDR測試數字信號測試哪里買抖動是數字信號,特別是高速數字信號重要的一個概念,越是高速的信號,其比特周期越短對于抖動要求就嚴格;

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數字信號的上升時間(Rising Time)

任何一個真實的數字信號在由一個邏輯電平狀態(tài)跳轉到另一個邏輯電平狀態(tài)時,其中間的過渡時間都不會是無限短的。信號電平跳變的過渡時間越短,說明信號邊沿越陡。我們通常使用上升時間(RisingTime)這個參數來衡量信號邊沿的陡緩程度,通常上升時間是指數字信號由幅度的10%增加到幅度的90%所花的時間(也有些場合會使用20%~80%的上升時間或其他標準)。上升時間越短,說明信號越陡峭。大部分數字信號的下降時間(信號從幅度的90%下降到幅度的10%所花的時間)和上升時間差不多(也有例外)。圖1.2比較了兩種不同上升時間的數字信號。上升時間可以客觀反映信號邊沿的陡緩程度,而且由于計算和測量簡單,所以得到的應用。對有些非常高速的串行數字信號,如PCIe、USB3.0、100G以太網等信號,由于信號速率很高,傳輸線對信號的損耗很大,信號波形中很難找到穩(wěn)定的幅度10%和90%的位置,所以有時也會用幅度20%~80%的上升時間來衡量信號的陡緩程度。通常速率越高的信號其上升時間也會更陡一些(但不一定速率低的信號上升時間一定就緩),上升時間是數字信號分析中的一個非常重要的概念,后面我們會反復提及和用到這個概念。

簡單的去加重實現方法是把輸出信號延時一個或多個比特后乘以一個加權系數并和 原信號相加。一個實現4階去加重的簡單原理圖。

去加重方法實際上壓縮了信號直流電平的幅度,去加重的比例越大,信號直流電平被壓縮得越厲害,因此去加重的幅度在實際應用中一般很少超過-9.5dB。做完預加重或者去加重的信號,如果在信號的發(fā)送端(TX)直接觀察,并不是理想的眼圖。圖1.31所示是在發(fā)送端看到的一個帶-3.5dB預加重的10Gbps的信號眼圖,從中可以看到有明顯的“雙眼皮”現象。 傳統(tǒng)的數字信號帶寬計算;

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很多經典的處理器采用了并行的總線架構。比如大家熟知的51單片機就采用了8根并行數據線和16根地址線;CPU的鼻祖——Intel公司的8086微處理器——**初推出時具有16根并行數據線和16根地址線;

現在很多嵌入式系統(tǒng)中多使用的ARM處理器則大部分使用32根數據線以及若干根地址線。并行總線的比較大好處是總線的邏輯時序比較簡單,電路實現起來比較容易;但是缺點也是非常明顯的,比如并行總線的信號線數量非常多,會占用大量的引腳和布線空間,因此芯片和PCB的尺寸很難實現小型化,特別是如果要用電纜進行遠距離傳輸時,由于信號線的數量非常多,使得電纜變得非常昂貴和笨重。 數字信號是由“0”和“1”。北京數字信號測試調試

數字信號抖動的成因(Root Cause of Jitter);校準數字信號測試銷售

由于真正的預加重電路在實現時需要有相應的放大電路來增加跳變比特的幅度,電路  比較復雜而且增加系統(tǒng)功耗,所以在實際應用時更多采用去加重的方式。去加重技術不是  增大跳變比特的幅度,而是減小非跳變比特的幅度,從而得到和預加重類似的信號波形。 圖 1.29是對一個10Gbps的信號進行-3.5dB的去加重后對頻譜的影響。可以看到,去加  重主要是通過壓縮信號的直流和低頻分量(長0 或者長 1  的比特流),從而改善其在傳輸過  程中可 能造成的對短0或者短1 比特的影響。校準數字信號測試銷售

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建立時間和保持時間加起來的時間稱為建立/保持時間窗口,是接收端對于信號保持在 同一個邏輯狀態(tài)的**小的時間要求。數字信號的比特寬度如果窄于這個時間窗口就肯定無 法同時滿足建立時間和保持時間的要求,所以接收端對于建立/保持時間窗口大小的要求實 際上決定了這個電路能夠工作的比較高的數據速率。通常工 作速率高一些的芯片,很短的建 立時間、保持時間就可以保證電路可靠工作,而工作速率低一 些的芯片則會要求比較長的建 立時間和保持時間。 另外要注意的是, 一個數字電路能夠可靠工作的比較高數據速率不僅取決于接收端對于 建立/保持時間的要求,輸出端的上升時間過緩、輸出幅度偏小、信號和時鐘中有抖動、信...

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