數(shù)據(jù)經(jīng)過8b/10b編碼后有以下優(yōu)點(diǎn)：

(1)有足夠多的跳變沿，可以從數(shù)據(jù)中進(jìn)行時(shí)鐘恢復(fù)。正常傳輸?shù)臄?shù)據(jù)中可能會(huì)有比較長(zhǎng)的連續(xù)的0或者連續(xù)的1,而進(jìn)行完8b/10b編碼后，其編碼規(guī)則保證了編碼后的數(shù)據(jù)流中不會(huì)出現(xiàn)超過5個(gè)連續(xù)的0或1,信號(hào)中會(huì)出現(xiàn)足夠多的跳變沿，因此可以采用嵌入式的時(shí)鐘方式，即接收端可以從數(shù)據(jù)流中通過PLL電路直接恢復(fù)時(shí)鐘，不需要專門的時(shí)鐘傳輸通道。

(2)直流平衡，可以采用AC耦合方式。經(jīng)過編碼后數(shù)據(jù)中不會(huì)出現(xiàn)連續(xù)的0或者1, 但還是有可能在某個(gè)時(shí)間段內(nèi)0或者1的數(shù)量偏多一些。從上面的編碼表中我們可以看 到，同一個(gè)Byte對(duì)應(yīng)有正、負(fù)兩組10bit的編碼， 一個(gè)編碼中1的數(shù)量多一些，另一個(gè)編碼中 0 的數(shù)量多一些。數(shù)據(jù)在對(duì)當(dāng)前的Byte進(jìn)行8b/10b編碼傳輸時(shí)，會(huì)根據(jù)前面歷史傳輸?shù)?數(shù)據(jù)中正負(fù)bit的數(shù)量來選擇使用哪一組編碼，從而可以保證總線上正負(fù)bit的數(shù)量在任何 時(shí)刻基本都是平衡的，也就是直流點(diǎn)不會(huì)發(fā)生大的變化。直流點(diǎn)平衡以后，在信號(hào)傳輸?shù)穆?徑上我們就可以采用AC耦合方式(常用的方法是在發(fā)送端或接收端串接隔直電容),這  樣信號(hào)對(duì)于收發(fā)端的地電平變化和共模噪聲的抵抗能力進(jìn)一步增強(qiáng)，可以傳輸更遠(yuǎn)的距離。 數(shù)字通信的帶寬表征為：bit的傳輸速率；USB測(cè)試數(shù)字信號(hào)測(cè)試代理商

時(shí)間偏差的衡量方法。由于信號(hào)邊沿的時(shí)間偏差可能是由于各種因素造成的，有隨機(jī)的噪聲，還有確定性的干擾。所以這個(gè)時(shí)間偏差通常不是一個(gè)恒定值，而是有一定的統(tǒng)計(jì)分布，在不同的應(yīng)用場(chǎng)合這個(gè)測(cè)量的結(jié)果可能是用有效值(RMS)衡量，也可能是用峰-峰值(peak-peak)衡量，更復(fù)雜的場(chǎng)合還會(huì)對(duì)這個(gè)時(shí)間偏差的各個(gè)成分進(jìn)行分解和估計(jì)。因此抖動(dòng)的精確測(cè)量需要大量的樣本以及復(fù)雜的算法。對(duì)抖動(dòng)進(jìn)行衡量和測(cè)量時(shí)，需要特別注意的是，即使對(duì)于同一個(gè)信號(hào)，如果用不同的方法進(jìn)行衡量，得到的抖動(dòng)測(cè)量結(jié)果也可能不一樣，下面是幾種常用的抖動(dòng)測(cè)量項(xiàng)目。USB測(cè)試數(shù)字信號(hào)測(cè)試代理商抖動(dòng)是數(shù)字信號(hào)，特別是高速數(shù)字信號(hào)重要的一個(gè)概念，越是高速的信號(hào)，其比特周期越短對(duì)于抖動(dòng)要求就嚴(yán)格；

對(duì)于典型的3.3V的低電壓TTL(LVTTL)信號(hào)來說，判決閾值的下限是0.8V,判決閾 值的上限是2.0V。正是由于判決閾值的存在，使得數(shù)字信號(hào)相對(duì)于模擬信號(hào)來說有更高的 可靠性和抗噪聲的能力。比如對(duì)于3.3V的LVTTL信號(hào)來說，當(dāng)信號(hào)輸出電壓為0V時(shí)， 只要噪聲或者干擾的幅度不超過0.8V,就不會(huì)把邏輯狀態(tài)由0誤判為1;同樣，當(dāng)信號(hào)輸出  電壓為3.3V時(shí)，只要噪聲或者干擾的幅度不會(huì)使信號(hào)電壓低于2.0V,就不會(huì)把邏輯狀態(tài)  由1誤判為0。

從上面的例子可以看到，數(shù)字信號(hào)抗噪聲和干擾的能力是比較強(qiáng)的。但也需要注意，這 個(gè)“強(qiáng)”是相對(duì)的，如果噪聲或干擾的影響使得信號(hào)的電壓超出了其正常邏輯的判決區(qū)間，數(shù)字信號(hào)也仍然有可能產(chǎn)生錯(cuò)誤的數(shù)據(jù)傳輸。在許多場(chǎng)合，我們對(duì)數(shù)字信號(hào)質(zhì)量進(jìn)行分析和 測(cè)試的基本目的就是要保證其信號(hào)電平在進(jìn)行采樣時(shí)滿足基本的邏輯判決條件。

采用串行總線以后，就單根線來說，由于上面要傳輸原來多根線傳輸?shù)臄?shù)據(jù)，所以其工作速率一般要比相應(yīng)的并行總線高很多。比如以前計(jì)算機(jī)上的擴(kuò)展槽上使用的PCI總線采用并行32位的數(shù)據(jù)線，每根數(shù)據(jù)線上的數(shù)據(jù)傳輸速率是33Mbps,演變到PCle(PCI-express)的串行版本后每根線上的數(shù)據(jù)速率至少是2.5Gbps(PCIel.0代標(biāo)準(zhǔn)),現(xiàn)在PCIe的數(shù)據(jù)速率已經(jīng)達(dá)到了16Gbps(PCIe4.0代標(biāo)準(zhǔn))或32Gbps(PCIe5.0代標(biāo)準(zhǔn))。采用串行總線的另一個(gè)好處是在提高數(shù)據(jù)傳輸速率的同時(shí)節(jié)省了布線空間，芯片的功耗也降低了，所以在現(xiàn)代的電子設(shè)備中，當(dāng)需要進(jìn)行高速數(shù)據(jù)傳輸時(shí)，使用串行總線的越來越多。

數(shù)據(jù)速率提高以后，對(duì)于阻抗匹配、線路損耗和抖動(dòng)的要求就更高，稍不注意就很容易產(chǎn)生信號(hào)質(zhì)量的問題。圖1.10是一個(gè)典型的1Gbps的信號(hào)從發(fā)送端經(jīng)過芯片封裝、PCB、連接器、背板傳輸?shù)浇邮斩说男盘?hào)路徑，可以看到在發(fā)送端的接近理想的0、1跳變的數(shù)字信號(hào)到達(dá)接收端后由于高頻損耗、反射等的影響，信號(hào)波形已經(jīng)變得非常惡劣，所以串行總線的設(shè)計(jì)對(duì)于數(shù)字電路工程師來說是一個(gè)很大的挑戰(zhàn)。 幅度測(cè)量是數(shù)字信號(hào)常用的測(cè)量，也是很多其他參數(shù)側(cè)魯昂的基礎(chǔ)。

抖動(dòng)的頻率范圍。抖動(dòng)實(shí)際上是時(shí)間上的噪聲，其時(shí)間偏差的變化頻率可能比較  快也可能比較慢。通常把變化頻率超過10Hz以上的抖動(dòng)成分稱為jitter,而變化頻率低于  10Hz的抖動(dòng)成分稱為wander(漂移)。wander主要反映的是時(shí)鐘源隨著時(shí)間、溫度等的緩  慢變化，影響的是時(shí)鐘或定時(shí)信號(hào)的***精度。在通信或者信號(hào)傳輸中，由于收發(fā)雙方都會(huì)  采用一定的時(shí)鐘架構(gòu)來進(jìn)行時(shí)鐘的分配和同步，緩慢的時(shí)鐘漂移很容易被跟蹤上或補(bǔ)償?shù)簦?因此wander對(duì)于數(shù)字電路傳輸?shù)恼`碼率影響不大，高速數(shù)字電路測(cè)量中關(guān)心的主要是高  頻的jitter。數(shù)字信號(hào)是指用一組特殊的狀態(tài)來描述信號(hào)；USB測(cè)試數(shù)字信號(hào)測(cè)試代理商

數(shù)字信號(hào)的波形分析（Waveform Analysis）;USB測(cè)試數(shù)字信號(hào)測(cè)試代理商

要把并行的信號(hào)通過串行總線傳輸，一般需要對(duì)數(shù)據(jù)進(jìn)行并/串轉(zhuǎn)換。為了進(jìn)一步減少傳輸線的數(shù)量和提高傳輸距離，很多高速數(shù)據(jù)總線采用嵌入式時(shí)鐘和8b/10b的數(shù)據(jù)編碼方式。8b/10b編碼由于直流平衡、支持AC耦合、可嵌入時(shí)鐘信息、抗共模干擾能力強(qiáng)、編解碼結(jié)構(gòu)相對(duì)簡(jiǎn)單等優(yōu)點(diǎn)，在很多高速的數(shù)字總線如FiberChannel、PCIe、SATA、USB3.0、DisplayPort、XAUI、RapidIO等接口上得到廣泛應(yīng)用。圖1.20是一路串行的2.5Gbps的8b/10b編碼后的數(shù)據(jù)流以及相應(yīng)的解碼結(jié)果，從中可以明顯看到解出的K28.5等控制碼以及相應(yīng)的數(shù)據(jù)信息。USB測(cè)試數(shù)字信號(hào)測(cè)試代理商

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