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企業(yè)商機(jī)
數(shù)字信號(hào)測(cè)試基本參數(shù)
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數(shù)字信號(hào)測(cè)試企業(yè)商機(jī)

基本上可以看到數(shù)字信號(hào)的頻域分量大部分集中在1/7U,這個(gè)頻率以下,我們可以將這個(gè)頻率稱之為信號(hào)的帶寬,工程上可以近似為0.35/0,當(dāng)對(duì)設(shè)計(jì)要求嚴(yán)格的時(shí)候,也可近似為0.5/rro

也就是說,疊加信號(hào)帶寬(0.35/。)以下的頻率分量基本上可以復(fù)現(xiàn)邊沿時(shí)間是tr的數(shù)字時(shí);域波形信號(hào)。這個(gè)頻率通常也叫作轉(zhuǎn)折頻率或截止頻率(Fknee或cutofffrequency)

*信號(hào)的能量大部分集中在信號(hào)帶寬以下,意味著我們?cè)诳紤]這個(gè)信號(hào)的傳輸效應(yīng)時(shí),主要關(guān)注比較高頻率可以到信號(hào)的帶寬。

所以,假如在數(shù)字信號(hào)的傳輸過程中可以保證在信號(hào)的帶寬(0.35億)以下的頻率分量(模擬信號(hào))經(jīng)過互連路徑的質(zhì)量,則我們可以保證接收到比較完整的數(shù)字信號(hào)。

然而,我們會(huì)在下面看到在考慮信號(hào)完整性問題時(shí)由于傳輸路徑阻抗不連續(xù)對(duì)信號(hào)的反射,損耗隨頻率的增加而增加的特性等因素,這些頻率分量在傳輸時(shí)會(huì)有畸變,從而造成接收到的各個(gè)頻率的分量疊加在時(shí)并不能完全保證復(fù)現(xiàn)原有的時(shí)域的數(shù)字信號(hào)。 高速數(shù)字接口原理與測(cè)試;福建數(shù)字信號(hào)測(cè)試工廠直銷

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要想得到零邊沿時(shí)間的理想方波,理論上是需要無窮大頻率的頻率分量。如果比較高只考慮到某個(gè)頻率點(diǎn)處的頻率分量,則來出的時(shí)域波形邊沿時(shí)間會(huì)蛻化,會(huì)使得邊沿時(shí)間增大。例如,一個(gè)頻率為500MHz的理想方波,其5次諧波分量是2500M,如果把5次諧波以內(nèi)所有分量成時(shí)域信號(hào),貝U其邊沿時(shí)間大概是0.35/2500M=0.14ns,即140ps。

我們可以把數(shù)字信號(hào)假設(shè)為一個(gè)時(shí)間軸上無窮的梯形波的周期信號(hào),它的傅里葉變換

對(duì)應(yīng)于每個(gè)頻率點(diǎn)的正弦波的幅度,我們可以勾勒出虛線所示的頻譜包絡(luò)線, 可以看到它有兩個(gè)轉(zhuǎn)折頻率分別對(duì)應(yīng)1/材和1/”(刁是半周期,。是邊沿時(shí)間)

從1/叫轉(zhuǎn)折頻率開始,頻譜的諧波分量是按I/?下降的,也就是-40dB/dec (-40分貝每 十倍頻,即每增大十倍頻率,諧波分量減小100倍)。可以看到相對(duì)于理想方波,從這個(gè)頻 率開始,信號(hào)的諧波分量大大減小。 安徽數(shù)字信號(hào)測(cè)試執(zhí)行標(biāo)準(zhǔn)數(shù)字信號(hào)是離散的。它的幅度被限制在一個(gè)確定的值。

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這種并/串轉(zhuǎn)換方法由于不涉及信號(hào)的編解碼,結(jié)構(gòu)簡(jiǎn)單,效率較高,但是需要收發(fā)端進(jìn)行精確的時(shí)鐘同步以控制信號(hào)的復(fù)用和解復(fù)用操作,因此需要專門的時(shí)鐘傳輸通道,而且串行信號(hào)上一旦出現(xiàn)比較大的抖動(dòng)就會(huì)造成串/并轉(zhuǎn)換的錯(cuò)誤。

因此,這種簡(jiǎn)單的并/串轉(zhuǎn)換方式一般用于比較關(guān)注傳輸效率的芯片間的短距離互連或者一些光端機(jī)信號(hào)的傳輸中。另外,由于信號(hào)沒有經(jīng)過任何編碼,信號(hào)中可能會(huì)出現(xiàn)比較長(zhǎng)的連續(xù)的0或者連續(xù)的1,因此信號(hào)必須采用直流耦合方式,收發(fā)端一旦存在比較大的共?;虻卦肼暎瑫?huì)嚴(yán)重影響信號(hào)質(zhì)量,因此這種并/串轉(zhuǎn)換方式用于電信號(hào)傳輸時(shí)或者傳輸速率不太高(通常<1Gbps),或者傳輸距離不太遠(yuǎn)(通常<50cm)的場(chǎng)合。

數(shù)據(jù)經(jīng)過8b/10b編碼后有以下優(yōu)點(diǎn):

(1)有足夠多的跳變沿,可以從數(shù)據(jù)中進(jìn)行時(shí)鐘恢復(fù)。正常傳輸?shù)臄?shù)據(jù)中可能會(huì)有比較長(zhǎng)的連續(xù)的0或者連續(xù)的1,而進(jìn)行完8b/10b編碼后,其編碼規(guī)則保證了編碼后的數(shù)據(jù)流中不會(huì)出現(xiàn)超過5個(gè)連續(xù)的0或1,信號(hào)中會(huì)出現(xiàn)足夠多的跳變沿,因此可以采用嵌入式的時(shí)鐘方式,即接收端可以從數(shù)據(jù)流中通過PLL電路直接恢復(fù)時(shí)鐘,不需要專門的時(shí)鐘傳輸通道。

(2)直流平衡,可以采用AC耦合方式。經(jīng)過編碼后數(shù)據(jù)中不會(huì)出現(xiàn)連續(xù)的0或者1, 但還是有可能在某個(gè)時(shí)間段內(nèi)0或者1的數(shù)量偏多一些。從上面的編碼表中我們可以看 到,同一個(gè)Byte對(duì)應(yīng)有正、負(fù)兩組10bit的編碼, 一個(gè)編碼中1的數(shù)量多一些,另一個(gè)編碼中 0 的數(shù)量多一些。數(shù)據(jù)在對(duì)當(dāng)前的Byte進(jìn)行8b/10b編碼傳輸時(shí),會(huì)根據(jù)前面歷史傳輸?shù)?數(shù)據(jù)中正負(fù)bit的數(shù)量來選擇使用哪一組編碼,從而可以保證總線上正負(fù)bit的數(shù)量在任何 時(shí)刻基本都是平衡的,也就是直流點(diǎn)不會(huì)發(fā)生大的變化。直流點(diǎn)平衡以后,在信號(hào)傳輸?shù)穆?徑上我們就可以采用AC耦合方式(常用的方法是在發(fā)送端或接收端串接隔直電容),這  樣信號(hào)對(duì)于收發(fā)端的地電平變化和共模噪聲的抵抗能力進(jìn)一步增強(qiáng),可以傳輸更遠(yuǎn)的距離。 數(shù)字此案好的上升時(shí)間(Rising Time);

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抖動(dòng)的頻率范圍。抖動(dòng)實(shí)際上是時(shí)間上的噪聲,其時(shí)間偏差的變化頻率可能比較  快也可能比較慢。通常把變化頻率超過10Hz以上的抖動(dòng)成分稱為jitter,而變化頻率低于  10Hz的抖動(dòng)成分稱為wander(漂移)。wander主要反映的是時(shí)鐘源隨著時(shí)間、溫度等的緩  慢變化,影響的是時(shí)鐘或定時(shí)信號(hào)的***精度。在通信或者信號(hào)傳輸中,由于收發(fā)雙方都會(huì)  采用一定的時(shí)鐘架構(gòu)來進(jìn)行時(shí)鐘的分配和同步,緩慢的時(shí)鐘漂移很容易被跟蹤上或補(bǔ)償?shù)簦?因此wander對(duì)于數(shù)字電路傳輸?shù)恼`碼率影響不大,高速數(shù)字電路測(cè)量中關(guān)心的主要是高  頻的jitter。數(shù)字信號(hào)是由“0”和“1”。安徽數(shù)字信號(hào)測(cè)試執(zhí)行標(biāo)準(zhǔn)

數(shù)字 信號(hào)處理系統(tǒng)的基本組成;福建數(shù)字信號(hào)測(cè)試工廠直銷

對(duì)于一個(gè)理想的方波信號(hào),其上升沿是無限陡的,從頻域上看 它是由無限多的奇數(shù)次諧波構(gòu)成的,因此一個(gè)理想方波可以認(rèn)為是無限多奇次正弦諧波 的疊加。

但是對(duì)于真實(shí)的數(shù)字信號(hào)來說,其上升沿不是無限陡的,因此其高次諧波的能量會(huì)受到 限制。比如圖1.3是用同一個(gè)時(shí)鐘芯片分別產(chǎn)生的50MHz和250MHz的時(shí)鐘信號(hào)的頻 譜,我們可以看到雖然兩種情況下輸出時(shí)鐘頻率不一樣,但是信號(hào)的主要頻譜能量都集中在 5GHz以內(nèi),并不見得250MHz時(shí)鐘的頻譜分布就一定比50MHz時(shí)鐘的大5倍。 福建數(shù)字信號(hào)測(cè)試工廠直銷

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建立時(shí)間和保持時(shí)間加起來的時(shí)間稱為建立/保持時(shí)間窗口,是接收端對(duì)于信號(hào)保持在 同一個(gè)邏輯狀態(tài)的**小的時(shí)間要求。數(shù)字信號(hào)的比特寬度如果窄于這個(gè)時(shí)間窗口就肯定無 法同時(shí)滿足建立時(shí)間和保持時(shí)間的要求,所以接收端對(duì)于建立/保持時(shí)間窗口大小的要求實(shí) 際上決定了這個(gè)電路能夠工作的比較高的數(shù)據(jù)速率。通常工 作速率高一些的芯片,很短的建 立時(shí)間、保持時(shí)間就可以保證電路可靠工作,而工作速率低一 些的芯片則會(huì)要求比較長(zhǎng)的建 立時(shí)間和保持時(shí)間。 另外要注意的是, 一個(gè)數(shù)字電路能夠可靠工作的比較高數(shù)據(jù)速率不僅取決于接收端對(duì)于 建立/保持時(shí)間的要求,輸出端的上升時(shí)間過緩、輸出幅度偏小、信號(hào)和時(shí)鐘中有抖動(dòng)、信...

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