DDR數(shù)據(jù)總線的一致性測試

DQS (源同步時鐘)和DQ (數(shù)據(jù))的波形參數(shù)測試與命令地址總線測試類似，比較簡 單，在此不做詳細介紹。對于DDR1, DQS是單端信號，可以用單端探頭測試；DDR2&3 DQS 則是差分信號，建議用差分探頭測試，減小探測難度。DQS和DQ波形包括三態(tài)(T特征，以及讀數(shù)據(jù)(Read Burst)、寫數(shù)據(jù)(Write Burst)的DQS和DQ的相對時序特征。在 我們測試時，只是捕獲了這樣的波形，然后測試出讀、寫操作時的建立時間和保持時間參數(shù) 是不夠的，因為數(shù)據(jù)碼型是變化的，猝發(fā)長度也是變化的，只測試幾個時序參數(shù)很難覆蓋各 種情況，更難測出差情況。很多工程師花了一周時間去測試DDR,卻仍然測不出問題的關(guān) 鍵點就在于此。因此我們應(yīng)該用眼圖的方式去測試DDR的讀、寫時序，確保反映整體時序情 況并捕獲差情況下的波形，比較好能夠套用串行數(shù)據(jù)的分析方法，調(diào)用模板幫助判斷。 擴展 DDR4 和 LPDDR4 合規(guī)性測試軟件的功能。眼圖測試DDR一致性測試推薦貨源

在進行接收容限測試時，需要用到多通道的誤碼儀產(chǎn)生帶壓力的DQ、DQS等信號。測 試 中 被 測 件 工 作 在 環(huán) 回 模 式 ， D Q 引 腳 接 收 的 數(shù) 據(jù) 經(jīng) 被 測 件 轉(zhuǎn) 發(fā) 并 通 過 L B D 引 腳 輸 出 到 誤碼儀的誤碼檢測端口。在測試前需要用示波器對誤碼儀輸出的信號進行校準(zhǔn)，如DQS與 DQ的時延校準(zhǔn)、信號幅度校準(zhǔn)、DCD與RJ抖動校準(zhǔn)、壓力眼校準(zhǔn)、均衡校準(zhǔn)等。圖5.21 展示了一整套DDR5接收端容限測試的環(huán)境。

DDR4/5的協(xié)議測試

除了信號質(zhì)量測試以外，有些用戶還會關(guān)心DDR總線上真實讀/寫的數(shù)據(jù)是否正確， 以及總線上是否有協(xié)議的違規(guī)等，這時就需要進行相關(guān)的協(xié)議測試。DDR的總線寬度很  寬，即使數(shù)據(jù)線只有16位，加上地址、時鐘、控制信號等也有30多根線，更寬位數(shù)的總線甚  至?xí)玫缴习俑€。為了能夠?qū)@么多根線上的數(shù)據(jù)進行同時捕獲并進行協(xié)議分析，適  合的工具就是邏輯分析儀。DDR協(xié)議測試的基本方法是通過相應(yīng)的探頭把被測信號引到  邏輯分析儀，在邏輯分析儀中運行解碼軟件進行協(xié)議驗證和分析。 上海DDR一致性測試多端口矩陣測試DDR總線一致性測試對示波器帶寬的要求；

如果PCB的密度較高，有可能期望測量的引腳附近根本找不到合適的過孔(比如采用雙面BGA貼裝或采用盲埋孔的PCB設(shè)計時),這時就需要有合適的手段把關(guān)心的BGA引腳上的信號盡可能無失真地引出來。為了解決這種探測的難題，可以使用一種專門的BGAInterposer(BGA芯片轉(zhuǎn)接板，有時也稱為BGA探頭)。這是一個專門設(shè)計的適配器，使用時要把適配器焊接在DDR的內(nèi)存顆粒和PCB板中間，并通過轉(zhuǎn)接板周邊的焊盤把被測信號引出。BGA轉(zhuǎn)接板內(nèi)部有專門的埋阻電路設(shè)計，以盡可能減小信號分叉對信號的影響。一個DDR的BGA探頭的典型使用場景。

D D R 5 的 接 收 端 容 限 評 估 需 要 通 過 接 收 容 限 的 一 致 性 測 試 來 進 行 ， 主 要 測 試 的 項 目 有 D Q 信 號 的 電 壓 靈 敏 度 、 D Q S 信 號 的 電 壓 靈 敏 度 、 D Q S 的 抖 動 容 限 、 D Q 與 D Q S 的 時 序 容 限、DQ的壓力眼測試、DQ的均衡器特性等。

在DDR5的接收端容限測試中，也需要通過御用的測試夾具對被測件進行測試以及測試前的校準(zhǔn)。展示了一套DDR5的DIMM條的測試夾具，包括了CTC2夾具(ChannelTestCard)和DIMM板(DIMMTestCard)等。CTC2夾具上有微控制器和RCD芯片等，可以通過SMBus/I2C總線配置電路板的RCD輸出CA信號以及讓被測件進入環(huán)回模式。測試夾具還提供了CK/CA/DQS/DQ/LBD/LBS等信號的引出。 DDR2 3 4物理層一致性測試；

如果PCB的設(shè)計密度不高，用戶有可能在DDR顆粒的引腳附近找到PCB過孔，這時可以用焊接或點測探頭在過孔上進行信號測量。DDR總線信號質(zhì)量測試時經(jīng)常需要至少同時連接CLK、DQS、DQ等信號，且自動測試軟件需要運行一段時間，由于使用點測探頭人手很難長時間同時保持幾路信號連接的可靠性，所以通常會使用焊接探頭測試。有時為了方便，也可以把CLK和DQS焊接上，DQ根據(jù)需要用點測探頭進行測試。有些用戶會通過細銅線把信號引出再連接示波器探頭，但是因為DDR的信號速率很高，即使是一段1cm左右的沒有匹配的銅線也會嚴重影響信號的質(zhì)量，因此不建議使用沒有匹配的銅線引出信號。有些示波器廠商的焊接探頭可以提供稍長一些的經(jīng)過匹配的焊接線，可以嘗試一下這種焊接探頭。圖5.13所示就是一種用焊接探頭在過孔上進行DDR信號測試的例子。DDR時鐘總線的一致性測試。安徽DDR一致性測試聯(lián)系人

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DDR的信號仿真驗證

由于DDR芯片都是采用BGA封裝，密度很高，且分叉、反射非常嚴重，因此前期的仿 真是非常必要的。借助仿真軟件中專門針對DDR的仿真模型庫仿真出的通道損 耗以及信號波形。

仿真出信號波形以后，許多用戶需要快速驗證仿真出來的波形是否符合DDR相關(guān)規(guī) 范要求。這時，可以把軟件仿真出的DDR的時域波形導(dǎo)入到示波器中的DDR測試軟件中 ,并生成相應(yīng)的一致性測試報告，這樣可以保證仿真和測試分析方法的一致，并且 便于在仿真階段就發(fā)現(xiàn)可能的信號違規(guī) 眼圖測試DDR一致性測試推薦貨源

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