對(duì)于嵌入式應(yīng)用的DDR的協(xié)議測(cè)試， 一般是DDR顆粒直接焊接在PCB板上，測(cè)試可 以選擇針對(duì)邏輯分析儀設(shè)計(jì)的BGA探頭。也可以設(shè)計(jì)時(shí)事先在板上留測(cè)試點(diǎn)，把被測(cè)信 號(hào)引到一些按一定規(guī)則排列的焊盤(pán)上，再通過(guò)相應(yīng)探頭的排針頂在焊盤(pán)上進(jìn)行測(cè)試。

協(xié)議測(cè)試也可以和信號(hào)質(zhì)量測(cè)試、電源測(cè)試結(jié)合起來(lái)，以定位由于信號(hào)質(zhì)量或電源問(wèn)題 造成的數(shù)據(jù)錯(cuò)誤。圖5.23是一個(gè)LPDDR4的調(diào)試環(huán)境，測(cè)試中用邏輯分析儀觀察總線(xiàn)上 的數(shù)據(jù)，同時(shí)用示波器檢測(cè)電源上的紋波和瞬態(tài)變化，通過(guò)把總線(xiàn)解碼的數(shù)據(jù)和電源瞬態(tài)變 化波形做時(shí)間上的相關(guān)和同步觸發(fā)，可以定位由于電源變化造成的總線(xiàn)讀/寫(xiě)錯(cuò)誤問(wèn)題。 DDR、DDR2、DDR3、DDR4都有什么區(qū)別？HDMI測(cè)試DDR一致性測(cè)試項(xiàng)目

軟件運(yùn)行后，示波器會(huì)自動(dòng)設(shè)置時(shí)基、垂直增益、觸發(fā)等參數(shù)并進(jìn)行測(cè)量，測(cè)量結(jié)果會(huì) 匯總成一個(gè)html格式的測(cè)試報(bào)告，報(bào)告中列出了測(cè)試的項(xiàng)目、是否通過(guò)、spec的要求、實(shí)測(cè) 值、margin等。

使用自動(dòng)測(cè)試軟件的優(yōu)點(diǎn)如下所述：

?自動(dòng)化的設(shè)置向?qū)П苊膺B接和設(shè)置錯(cuò)誤；

?快速的測(cè)量和優(yōu)化的算法減少測(cè)試時(shí)間；

?可以測(cè)試JEDEC規(guī)定的速率也可以測(cè)試用戶(hù)自定義的數(shù)據(jù)速率;

?獨(dú)有的自動(dòng)讀寫(xiě)分離技術(shù)簡(jiǎn)化了測(cè)試操作；

?能夠多次測(cè)量并給出一個(gè)統(tǒng)計(jì)的結(jié)果；

?能夠根據(jù)信號(hào)斜率自動(dòng)計(jì)算建立/保持時(shí)間的修正值。 安徽DDR一致性測(cè)試銷(xiāo)售DDR4協(xié)議/功能調(diào)試和分析參考解決方案。

RDIMM(RegisteredDIMM,寄存器式雙列直插內(nèi)存)有額外的RCD(寄存器時(shí)鐘驅(qū)動(dòng)器，用來(lái)緩存來(lái)自?xún)?nèi)存控制器的地址/命令/控制信號(hào)等)用于改善信號(hào)質(zhì)量，但額外寄存器的引入使得其延時(shí)和功耗較大。LRDIMM(LoadReducedDIMM,減載式雙列直插內(nèi)存)有額外的MB(內(nèi)存緩沖，緩沖來(lái)自?xún)?nèi)存控制器的地址/命令/控制等),在技術(shù)實(shí)現(xiàn)上并未使用復(fù)雜寄存器，只是通過(guò)簡(jiǎn)單緩沖降低內(nèi)存總線(xiàn)負(fù)載。RDIMM和LRDIMM通常應(yīng)用在高性能、大容量的計(jì)算系統(tǒng)中。

綜上可見(jiàn)，DDR內(nèi)存的發(fā)展趨勢(shì)是速率更高、封裝更密、工作電壓更低、信號(hào)調(diào)理技術(shù) 更復(fù)雜，這些都對(duì)設(shè)計(jì)和測(cè)試提出了更高的要求。為了從仿真、測(cè)試到功能測(cè)試階段保證DDR信號(hào)的波形質(zhì)量和時(shí)序裕量，需要更復(fù)雜、更的仿真、測(cè)試和分析工具。

通常測(cè)量眼圖很有效的一種方法就是使用示波器的眼圖測(cè)量功能，即用時(shí)鐘做觸發(fā)對(duì)數(shù) 據(jù)信號(hào)進(jìn)行累積，看累積結(jié)果的差情況是否在可以容許的范圍內(nèi)。但遺憾的是，想用這種 方法直接測(cè)量DDR的信號(hào)質(zhì)量非常困難，因?yàn)镈DR信號(hào)讀寫(xiě)時(shí)序是不一樣的。

可以看到，寫(xiě)數(shù)據(jù)(DQ)的跳變位置對(duì)應(yīng)著鎖存信號(hào)(DQS)的中心，而 讀數(shù)據(jù)的跳變位置卻對(duì)應(yīng)著鎖存信號(hào)的邊沿，而且在總線(xiàn)上還有三態(tài)，因此如果直接用DQS 觸發(fā)對(duì)DQ累積進(jìn)行眼圖測(cè)量的話(huà)，會(huì)得到的結(jié)果。 DDR1 電氣一致性測(cè)試應(yīng)用軟件。

由于DDR4的數(shù)據(jù)速率會(huì)達(dá)到3.2GT/s以上，DDR5的數(shù)據(jù)速率更高，所以對(duì)邏輯分析儀的要求也要很高，需要狀態(tài)采樣時(shí)鐘支持1.6GHz以上且在雙采樣模式下支持3.2Gbps 以上的數(shù)據(jù)速率?；诟咚龠壿嫹治鰞x的DDR4/5協(xié)議測(cè)試系統(tǒng)。圖中是通過(guò) DIMM條的適配器夾具把上百路信號(hào)引到邏輯分析儀，相應(yīng)的適配器要經(jīng)過(guò)嚴(yán)格測(cè)試，確 保在其標(biāo)稱(chēng)的速率下不會(huì)因?yàn)樾盘?hào)質(zhì)量問(wèn)題對(duì)協(xié)議測(cè)試結(jié)果造成影響。目前的邏輯分析儀可以支持4Gbps以上信號(hào)的采集和分析。DDR2/3/4 和 LPDDR2/3 的協(xié)議一致性測(cè)試和分析工具箱。HDMI測(cè)試DDR一致性測(cè)試項(xiàng)目

DDR2 3 4物理層一致性測(cè)試；HDMI測(cè)試DDR一致性測(cè)試項(xiàng)目

在進(jìn)行接收容限測(cè)試時(shí)，需要用到多通道的誤碼儀產(chǎn)生帶壓力的DQ、DQS等信號(hào)。測(cè) 試 中 被 測(cè) 件 工 作 在 環(huán) 回 模 式 ， D Q 引 腳 接 收 的 數(shù) 據(jù) 經(jīng) 被 測(cè) 件 轉(zhuǎn) 發(fā) 并 通 過(guò) L B D 引 腳 輸 出 到 誤碼儀的誤碼檢測(cè)端口。在測(cè)試前需要用示波器對(duì)誤碼儀輸出的信號(hào)進(jìn)行校準(zhǔn)，如DQS與 DQ的時(shí)延校準(zhǔn)、信號(hào)幅度校準(zhǔn)、DCD與RJ抖動(dòng)校準(zhǔn)、壓力眼校準(zhǔn)、均衡校準(zhǔn)等。圖5.21 展示了一整套DDR5接收端容限測(cè)試的環(huán)境。

DDR4/5的協(xié)議測(cè)試

除了信號(hào)質(zhì)量測(cè)試以外，有些用戶(hù)還會(huì)關(guān)心DDR總線(xiàn)上真實(shí)讀/寫(xiě)的數(shù)據(jù)是否正確， 以及總線(xiàn)上是否有協(xié)議的違規(guī)等，這時(shí)就需要進(jìn)行相關(guān)的協(xié)議測(cè)試。DDR的總線(xiàn)寬度很  寬，即使數(shù)據(jù)線(xiàn)只有16位，加上地址、時(shí)鐘、控制信號(hào)等也有30多根線(xiàn)，更寬位數(shù)的總線(xiàn)甚  至?xí)玫缴习俑€(xiàn)。為了能夠?qū)@么多根線(xiàn)上的數(shù)據(jù)進(jìn)行同時(shí)捕獲并進(jìn)行協(xié)議分析，適  合的工具就是邏輯分析儀。DDR協(xié)議測(cè)試的基本方法是通過(guò)相應(yīng)的探頭把被測(cè)信號(hào)引到  邏輯分析儀，在邏輯分析儀中運(yùn)行解碼軟件進(jìn)行協(xié)議驗(yàn)證和分析。 HDMI測(cè)試DDR一致性測(cè)試項(xiàng)目

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